本文由公司网站滚圆机网站采集转载中国知网整理! http://www.gunyuanjixie.com字逻辑电路实验中的具体应用。在此设计一个带有复位端的计数器,端口分别为:clk(时钟,输入端,位宽为1),res(复位,输入端,位宽为1),cnt[2,0](计数端,输出端,位宽为3)。时钟clk为上升沿触发,复位res低有效,计数端cnt[2,0]有效数据范围为3’b000~3’b100。程序流程图如图2所示。图2五进制计数器流程图通过对五进制计数器的分析,用VerilogHDL描述出功能后,在QuartusII11.0软件上联合Modelsim进行仿真后,得到如图3所示的仿真波形。图3五进制加法计数器仿真波形通过波形图我们可以看出本文由公司网站滚圆机网站采集转载中国知网资源整理!www.gunyuanj
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